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General

Profile

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Table of Contents
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1::Clock Frequency Summary
2::Clock Relationship Summary
3::Datasheet Report
3.1::Setup to Clock
3.2::Clock to Out
3.3::Pad to Pad
4::Path Details for Clock Frequency Summary
5::Path Details for Clock Relationship Summary
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End of Table of Contents
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1::Clock Frequency Summary
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Number of clocks: 10
Clock: Clock_1 | N/A | Target: 0.00 MHz |
Clock: Clock_1(FFB) | N/A | Target: 0.00 MHz |
Clock: CyECO | N/A | Target: 24.00 MHz |
Clock: CyHFCLK | N/A | Target: 48.00 MHz |
Clock: CyILO | N/A | Target: 0.03 MHz |
Clock: CyIMO | N/A | Target: 48.00 MHz |
Clock: CyLFCLK | N/A | Target: 0.03 MHz |
Clock: CyRouted1 | N/A | Target: 48.00 MHz |
Clock: CySYSCLK | N/A | Target: 48.00 MHz |
Clock: CyWCO | N/A | Target: 0.03 MHz |

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End of Clock Frequency Summary
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2::Clock Relationship Summary
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Launch Clock Capture Clock Constraint(R-R) Slack(R-R) Constraint(R-F) Slack(R-F) Constraint(F-F) Slack(F-F) Constraint(F-R) Slack(F-R)

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End of Clock Relationship Summary
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3::Datasheet Report

All values are in Picoseconds
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3.1::Setup to Clock
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Port Name Setup to Clk Clock Name:Phase
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-----------------------3.2::Clock to Out
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Port Name Clock to Out Clock Name:Phase
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Red_LED(0)_PAD 19469 Clock_1(FFB):R


3.3::Pad to Pad
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Port Name (Source) Port Name (Destination) Delay
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End of Datasheet Report
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4::Path Details for Clock Frequency Summary

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End of Path Details for Clock Frequency Summary
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5::Path Details for Clock Relationship Summary
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End of Path Details for Clock Relationship Summary
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Detailed Report for all timing paths
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End of Detailed Report for all timing paths
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End of Timing Report
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